INT4 SWAR 도트곱 합성 및 형식 증명

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TL;DR

INT4 양자화를 위한 SWAR 도트곱 구현을 SMT 기반 CEGIS 루프로 자동 합성하고 Lean 4로 전 입력 범위에 대한 등가성을 기계적으로 증명한 작업이다. Z3를 후보 생성 엔진으로 써서 허용된 비트 연산 집합 내에서 브랜치 없는 연산 시퀀스를 찾고 무작위 테스트와 반례 피드백으로 수렴시켰다. 합성 결과를 Lean 4로 포팅해 bv_decide와 모듈러 산술 도구로 나이브 루프와의 동치성을 증명해 완전 검증을 확보했으며, 코드와 증명 스크립트는 깃허브에 공개되어 있다.

커뮤니티 반응

댓글 반응은 호기심과 실무적 관심이 섞인 편이며, 코드와 증명이 공개된 점을 긍정적으로 받아들였다. 몇몇 사용자는 Z3의 탐색 비용과 스케일 문제를 지적하며 허용 연산 축소나 비용 기반 가중치 도입을 권했고, 다른 이들은 Lean 4로 완전 검증한 점을 높게 평가했다. 성능 비교나 실제 ARM/WebAssembly 성능 측정 결과를 더 보고 싶다는 요청이 여럿 있었다.

주요 논점

01찬성다수

자동 합성+형식 증명 조합은 사람이 만들기 힘든 미세한 비트 경계 조건을 제거해 안전한 최적화 코드를 확보할 수 있다.

02중립다수

Z3로 더 짧은 명령 체인을 찾는 것은 가능하지만 탐색 시간·복잡도와의 균형을 맞추는 추가 제약 설계가 필요하다.

합의점 vs 논쟁점

합의점

비트 수준 최적화는 네이티브 SIMD가 없는 환경에서 성능을 크게 개선할 수 있고, 자동 합성은 수작업 오류를 줄일 수 있다는 점에 동의하는 경향이 강하다. 합성된 결과를 단위 테스트만으로 신뢰하기에는 한계가 있으므로 정형 증명 같은 추가 검증이 가치가 있다는 점에서도 공감대가 형성됐다. 다만 합성 시간과 코드 유지보수성 문제는 해결 과제로 받아들여졌다.
Z3 같은 SMT 기반 합성은 제약 설계와 연산 집합 선택에 매우 민감하므로 실전 적용 시 설계자 의도가 잘 반영된 제약을 신중히 구성해야 한다는 점에서 의견 일치가 있었다. 또한 Lean 같은 정리 증명기로 검증하면 안전성은 확보되지만 증명 자동화의 비용과 난이도가 도입 장벽이 된다는 점도 널리 인정됐다. 따라서 팀 규모와 사용 사례에 맞춘 도입 전략이 필요하다는 결론이 도출됐다.

논쟁점

자동으로 생성된 비트 트릭은 성능 면에서 유리하지만 인간에게는 난해한 코드가 되기 쉬워 유지보수 및 포팅에서 문제를 일으킬 수 있다. 일부는 증명 아티팩트를 문서화해 유지보수 비용을 낮춰야 한다고 주장했고, 다른 이는 생성 코드를 읽기 쉬운 형태로 리팩터링하면 증명과 불일치할 위험이 있다고 우려했다. 결국 생산성 향상과 장기 유지보수 비용 간의 트레이드오프가 쟁점이다.
Z3 기반 합성의 시간·자원 비용을 감수할 가치가 있는가가 논쟁거리였으며, 작은 프로젝트에서는 오버헤드가 클 수 있다는 지적이 나왔다. 반면 안전성이 절대적으로 중요한 시스템에서는 형식 증명까지 포함한 파이프라인 도입이 타당하다는 의견도 있었다. 이견은 주로 적용 도메인과 팀의 형식 증명 숙련도에 따라 갈렸다.

실용적 조언

작업을 시작할 때는 연산 집합을 최소화하고 해결해야 할 비트 폭을 가능한 한 작게 제한해 Z3의 탐색 공간을 줄이십시오. 작은 서브문제를 합성해 결합하는 방식으로 점진적 확장을 시도하면 탐색 실패로 인한 비용을 완화할 수 있습니다. 또한 후보를 자동 테스트로 빠르게 걸러낸 뒤 반례를 제약으로 되돌리는 CEGIS 루프를 엄격히 설정하는 것이 유리합니다.
성능 최적화를 목표로 할 때는 합성 단계에서 연산별 비용 함수를 도입해 연산 수나 곱셈·시프트 같은 고비용 연산을 페널티화하면 더 짧은 명령 체인을 유도할 수 있습니다. 솔버가 무차별적으로 복잡한 식을 생성하지 않도록 중간 형태의 매크로 연산(예: 특정 비트 재배열 템플릿)을 허용하는 것도 방법입니다. 실험적으로 다양한 제약 설정을 비교해 비용-성능 균형을 찾으시기 바랍니다.
증명 단계는 Lean 같은 정리 증명기로 포팅할 때 초기 학습 비용이 크므로 핵심 연산의 동치성만 먼저 증명하는 방식으로 범위를 좁히십시오. 무작위 테스트·반례 기반 검증·형식 증명을 단계적으로 결합하면 증명 비용을 분산할 수 있습니다. 최종적으로는 증명 산출물(스크립트·정리)을 코드와 함께 배포해 나중에 리팩터링하거나 포팅할 때 근거로 삼는 것이 좋습니다.

섹션별 상세

CEGIS 루프를 통해 수작업 비트 해킹 대신 SMT 기반 탐색으로 정해진 연산 집합 내에서 후보를 자동 생성한 점이 핵심이며, 구현자는 후보를 무작위 테스트로 검증하고 실패 케이스를 제약으로 되돌려 반복해 수렴을 유도했다. 이렇게 하면 사람이 놓치기 쉬운 상호작용을 solver가 찾아내며 브랜치 없는 순수 비트 연산 시퀀스를 얻을 수 있다. 다만 Z3의 탐색 공간과 시간 복잡도는 현실적 제약이므로 연산 집합과 비트 폭을 적절히 제한하는 설계가 필요하다고 보인다.

합성된 수식은 기법적으로 32비트 곱셈을 이용해 짝수·홀수 니블을 동시에 처리하는 형태를 활용하며, 특정 곱셈-비트정렬 트릭으로 두 개의 4비트 곱을 한 번의 레지스터 연산으로 처리하는 동작을 보인다. 이 방식은 하드웨어의 기본 곱셈 동작을 입력으로 삼아 연산량을 줄이는 것으로, WebAssembly나 구형 ARM에서 유용하다. 그러나 생성된 비트식의 가독성과 유지보수성은 떨어질 수 있으므로 코드 주석이나 검증 아티팩트가 중요하다.

기계적 증명 단계에서는 Lean 4의 bv_decide와 모듈러 산술 도구를 사용해 합성 결과와 나이브 루프 구현의 등가성을 전 입력 공간에서 검증했다. 무작위 테스트로 얻은 신뢰를 넘어 2^64 입력 조합 전체에 대한 형식적 보장을 확보한 점이 신뢰성에서 큰 차이를 만든다. 이 증명은 실수나 오버플로 같은 비트단위 엣지케이스를 제거해 하드웨어별 최적화 코드의 안전성을 높인다.

실무 적용 관점에서는 Z3로 더 짧은 명령 체인을 찾게 하려면 허용 연산 집합 축소, 특정 매크로 연산 허용, 혹은 비용 함수(연산 수·종류 가중치)를 도입해 솔버의 목적을 바꾸는 전략을 검토할 수 있다. 반면 증명 단계는 Lean으로 포팅하는 노력이 추가되므로 제품화할 때는 증명 대상 범위와 자동화 수준을 현실적으로 조정해야 한다. 궁극적으로는 합성·검증 파이프라인의 자동화와 개발 비용 사이에서 절충점을 찾는 일이 관건이다.

이미지 분석

Screenshot
이미지는 Peloxerat/int4-swar-dotprod 깃허브 페이지의 헤더를 보여주며 프로젝트 제목과 짧은 설명이 포함되어 있어 게시물의 출처와 공개 코드 존재를 확인할 수 있다. 기여자·이슈·스타 수 등의 메타 정보가 보이나 성능 수치나 코드 본문은 포함되어 있지 않아 구현 세부정보는 리포지토리로 이동해야 확인할 수 있다.
레포지토리 헤더 스크린샷

용어 해설

SIMD Within A Register(SWAR): — SWAR은 하나의 레지스터 내부에서 비트 연산만으로 여러 작은 정수를 병렬로 처리하는 기법으로, SIMD 명령이 없는 플랫폼에서 벡터 연산을 흉내내는 데 쓰인다. 입력을 비트 필드로 압축한 뒤 마스크·시프트·곱셈 같은 비트 연산으로 개별 요소를 추출·연산·합산하는 흐름을 따른다. WebAssembly나 구형 ARM처럼 네이티브 SIMD 지원이 없을 때 처리량을 높이는 현실적인 대안이다.
INT4 양자화(INT4 quantization): — INT4 양자화는 모델 가중치·활성화를 4비트 정수로 표현해 메모리와 대역폭을 줄이는 기법으로, 추론 비용을 크게 낮출 수 있다. 다만 내부 곱셈·누적 연산은 정밀도·오버플로 제어가 필요하므로 하드웨어별 최적화가 중요하다. SWAR 방식은 이런 4비트 벡터 연산을 일반 32비트 레지스터에서 효율적으로 구현하려는 시도와 직접 연결된다.
Counter-Example Guided Inductive Synthesis(CEGIS): — CEGIS는 SMT/검색 기반 합성에서 후보 해를 제안하고 반례를 통해 제약을 좁혀가며 올바른 프로그램을 찾는 루프다. 합성기에게 명세(정확한 동작)를 주고 제한된 연산 집합으로 가능한 식을 찾아내며, 실패 시 생성된 반례를 제약에 추가해 재탐색한다. 복잡한 비트작업 수식을 자동으로 발견할 때 사람의 수작업을 줄이는 유용한 방법이다.
Z3 SMT 솔버(Z3): — Z3는 부울·비트벡터·정수 등 다양한 이론을 처리하는 SMT 솔버로, 프로그램 합성·검증·제약해결에 널리 쓰인다. 이 프로젝트에서는 CEGIS 루프의 후보 생성·검증 엔진 역할을 하여 허용된 산술·논리 연산의 조합을 탐색하도록 구성됐다. 실제 입력을 통한 테스트와 결합하면 합성 후보의 유효성 검증 속도를 높일 수 있다.
Lean 4 정리 증명기(Lean 4): — Lean 4는 정형 증명을 작성하고 기계적으로 검증하는 기능을 제공하는 정리 증명기 언어이자 환경으로, 수학적 등가성·정합성 증명에 쓰인다. 이 사례에서는 합성된 SWAR 구현과 나이브 루프 구현의 비트단위 동치성을 Lean으로 리포트형 증명으로 고정했다. 자동화된 bv_decide와 모듈러 산술 도구를 조합해 전입력 공간에 대한 완전 검증을 달성했다.

코드 예제

python

while True:
    candidate = z3_solve(current_constraints)
    if candidate is None:
        break
    if test_candidate_randomly(candidate):
        accept(candidate)
        break
    else:
        counterexample = find_failing_input(candidate)
        add_constraint(counterexample)

이 파이썬 의사 코드는 CEGIS 루프의 핵심 흐름을 보여준다. Z3로 후보 연산 시퀀스를 생성하고, 무작위 입력으로 동작을 검증하며 실패하면 그 반례를 제약으로 다시 넣는다. 이러한 반복으로 브랜치 없는 순수 비트 연산 시퀀스까지 수렴시킨 뒤 최종 후보를 채택한다.

text

(ea_low * eb_low_rev) >>> 16

이 한 줄은 두 개의 4비트 곱셈을 하나의 32비트 곱셈으로 동시에 평가하는 트릭의 예다. 레지스터 내에서 서로 반대 위치에 있는 니블 곱을 정렬하고 상위 비트만 취하면 교차 간섭 없이 결과를 얻을 수 있다. 합성 과정에서 Z3가 이런 곱셈-정렬 패턴을 적절히 섞어 효율적인 연산 체인을 생성했다.

언급된 도구

Z3추천링크

SMT 기반 제약 해결 및 후보 합성 엔진으로 사용됨

Lean 4추천링크

합성된 SWAR 구현과 나이브 루프의 등가성에 대한 형식 증명 도구로 사용됨

Python중립

CEGIS 루프와 테스트 허브 구현에 사용된 스크립트 언어

언급된 리소스

GitHubPeloxerat/int4-swar-dotprod

API DocsZ3 Theorem Prover

API DocsLean Theorem Prover — Documentation